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崗位職責(zé)
負(fù)責(zé)ASIC芯片設(shè)計(jì)交付及提供相關(guān)工藝/工程技術(shù)支撐，對交付產(chǎn)品的質(zhì)量進(jìn)度成本負(fù)責(zé)。
1負(fù)責(zé)ASIC芯片從RTL到GDSII的詳細(xì)物理設(shè)計(jì)與驗(yàn)證工作，包括物理架構(gòu)規(guī)劃，布局布線電源規(guī)劃時(shí)鐘樹綜合時(shí)序收斂物理驗(yàn)證電源網(wǎng)絡(luò)分析和低功耗設(shè)計(jì)等，在PPA（性能功耗成本）達(dá)成設(shè)計(jì)/工藝窗口匹配等方面提供有競爭力的解決方案；
2負(fù)責(zé)ASIC芯片DFT設(shè)計(jì)及驗(yàn)證，對測試成本測試覆蓋率失效率交付時(shí)間負(fù)責(zé)，提供有競爭力的測試向量及解決方案，承載測試診斷協(xié)助工藝及測試問題快速定位。
任職要求
1微電子計(jì)算機(jī)通信工程數(shù)學(xué)自動化材料物理等相關(guān)專業(yè)本科及以上學(xué)歷；
2符合如下任一條件者優(yōu)先
（1）熟練掌握深亞微米后端物理設(shè)計(jì)流程，了解Synopsys/Cadence等數(shù)字芯片物理設(shè)計(jì)工具Calibre等物理驗(yàn)證工具及PT等時(shí)序驗(yàn)證工具；
（2）熟悉數(shù)字芯片DFT或前端邏輯設(shè)計(jì)流程，熟悉verilog等數(shù)字電路硬件描述設(shè)計(jì)語言，了解或能使用 Synopsys或 Mentor相關(guān)工具；
（3）研究方向與先進(jìn)半導(dǎo)體工藝制程及整合開發(fā)相關(guān)
3對工作充滿熱情有責(zé)任心做事細(xì)心學(xué)習(xí)能力強(qiáng)

職位類別：

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